Para resolver los problemas de transmisión de datos de imágenes CMOS de alta velocidad a través de cables de fibra óptica multicanal y grandes pérdidas de enlace, se ha desarrollado un sistema de transmisión de datos de imágenes CMOS de alta velocidad a través de fibra óptica. Hemos determinado claramente las condiciones de límite de la transmisión óptica de alta velocidad, partiendo de las características de pérdida en la cadena de transmisión del módulo de fibra óptica y estableciendo la señal eléctrica como un eslabón crucial de la transmisión. En función de la capacidad de transmisión del transmisor en todo el rango de temperatura y de la amplitud mínima de la señal recibida para un funcionamiento estable del receptor, hemos obtenido la máxima pérdida de inserción permitida en la cadena de transmisión eléctrica; basándonos en el modelo de pérdida de transmisión, se ha establecido una distancia de transmisión fiable limitada por la constante dieléctrica y la tangente de la pérdida. Teniendo en cuenta la interferencia mutua de la señal de alta velocidad de transmisión en el módulo de fibra óptica y la limitación del uso del material de contacto de pequeño paquete de electrodo de níquel para el aislamiento en proyectos aeroespaciales de alta fiabilidad, hemos propuesto un método de compensación de gran condensador de acoplamiento del paquete y el agujero que produce una falta de ajuste de la impedancia en la cadena. Para el protocolo aurora64b66b en el módulo GTX, hemos propuesto el uso de la señal de bandera vacía en la memoria intermedia FIFO para recuperar los límites de fila en el flujo de datos, y se han añadido marcadores de cabeza, cola e información de sincronización tales como marcadores K, códigos Reed-Solomon y marcas de inversión para reducir el consumo de recursos de memoria. Los resultados de la simulación muestran que, a una velocidad de transmisión de 10 Gbit/s, las pérdidas de eco de la placa de circuito impreso son inferiores a -10.243 2 dB, lo que es mejor que los requisitos de las normas OIF-CEI-04.0 y PCIe4.0, y la calidad de la transmisión de señales es buena; la pérdida de inserción es inferior a -1.477 65 dB, que es mejor que los requisitos del enlace. Durante las pruebas, la tasa de error continua durante 48 horas fue de 5,789×10^-16, el sistema es estable y fiable. En comparación con el antiguo protocolo, el nuevo método de interfaz del protocolo puede ahorrar un 3,6% de los recursos de almacenamiento de FPGA.

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