基于高层次融合的卷积神经网络FPGA硬件加速

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基于高层次融合的卷积神经网络FPGA硬件加速

信息科学 | 更新时间：2020-07-09

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- 基于高层次融合的卷积神经网络FPGA硬件加速
- FPGA-based hardware acceleration for CNNs developed using high-Level synthesis
- 魏楚亮，陈儒林，高谦，孙正隆
- 光学精密工程 2020年28卷第5期页码：1212-1219
- 作者机构：
  1.汕头大学电子工程系, 广东汕头 515063
  2.深圳市人工智能与机器人研究院, 广东深圳 518054
  3.香港中文大学(深圳) 理工学院, 广东深圳 518172
- 作者简介：
  魏楚亮(1979-)，男，广东揭阳人，博士，副教授，2006年于英国利物浦大学获得博士学位，主要从事人工智能、机器人、传感技术、智能工业控制、交通运输安全检测、FPGA设计等的研究。E-mail: clwei@stu.edu.cn
  陈儒林(1998-)，男，广东茂名人，主要从事机器学习、FPGA设计等的研究。E-mail: 16rlchen@stu.edu.cn CHEN Ru-lin, E-mail: 16rlchen@stu.edu.cn
- 基金信息：
  广东省普通高校特色创新项目(2018KTSCX061);揭阳市科技计划项目(2019007 & 2019065);广东省重大科技专项(2015B020233018);深圳市人工智能与机器人研究院项目(2019-INT010)
- DOI： 10.3788/OPE.20202805.1212
  中图分类号：
- 修回：2020-2-3 ，
  录用：2020-2-3 ，
- 稿件说明：
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